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　硬件仿真作為系統驗證的基礎

　　雖然虛擬原型和現場可編程門陣列 (FPGA) 原型在早期嵌入式軟件測試上已受到關注，但對于軟件和硬件的集成并無助益。前者缺乏追蹤硬件錯誤所需的硬件精確性，而對于盡快消除錯誤所需的硬件調試，后者能力有限。

　　因此，開發團隊和項目經理已轉而采用硬件仿真作為其驗證策略的基礎。硬件仿真是一種多功能驗證工具，有許多相關優勢，包括軟硬件協同驗證或測試硬件和軟件集成的功能。它已受到軟件開發者的注意，因為這是能夠確保嵌入式系統軟件通過底層硬件正常工作的唯一驗證工具。對于致力于調試復雜 SoC 設計的硬件工程師來說，這也是值得注意的，因為工程師可以憑借該方法追蹤硬件內的軟件錯誤或軟件行為中的硬件錯誤。硬件仿真的其他優勢包括快速匯編功能、軟件驗證、全面的設計調試和可擴展性，可滿足包括數十億應用程序特定集成電路 (ASIC) 門的設計。此外，它能夠以驗證嵌入式軟件和執行系統驗證必需的高速率來處理數十億驗證周期（圖 1）。

　　過去，硬件調試和測試是項目周期驗證部分的唯一工作，此作業由硬件描述語言 (HDL) 測試平臺驅動的邏輯軟件仿真進行管理。傳統的大箱式硬件仿真只用于最大型的設計。很多開發團隊已采用正式驗證對軟件仿真進行補充，以增加基礎覆蓋范圍并確保不遺漏特殊用例。但是，只有硬件仿真可以在比較可行的時間內完成 SoC 設計的全部驗證任務，并緩解與基于事件的軟件仿真相關的運行問題。

　　都是軟件內容的問題

　　SoC 的軟件內容使協同驗證成為驗證策略中一個非常重要的部分，因為它可以在投片前確認一個嵌入式 SoC 的硬件和軟件部分同時得到驗證且正確交互。

　　過去，如果設計流片后發生硬件問題，軟件開發者必須盡其所能設法圍繞問題進行編碼。在 SoC 完成之前驗證軟件，設計團隊可以在進入硅片階段之前解決硬件問題。如前所述，硬件仿真檢查用于確保嵌入式軟件根據規范在硬件上運行